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INGÉNIEUR-E R&D : ALGORITHME DE SYNCHRONISATION FLIGHT TEST F/H
Offre de stage publiée il y a 20 jours- Entreprise SAFRAN ELECTRONICS & DEFENSE
- Localisation Les Ulis, Ile-de-France, France
- Fonction INGÉNIEUR-E R&D : ALGORITHME DE SYNCHRONISATION FLIGHT TEST
- Type de contrat Stage
- Date de publication 08-11-2023
Description du poste
Safran est un groupe international de haute technologie opérant dans les domaines de la propulsion et des équipements aéronautiques, de l'espace et de la défense. Implanté sur tous les continents, le Groupe emploie plus de 92 000 collaborateurs pour un ch
Descriptif mission
Safran Data Systems, entité du groupe Safran, conçoit et fabrique une large gamme de produits et solutions dans les domaines de la télémesure bord & sol, du traitement embarqué de l'information, de l'acquisition et enregistrement de données, du contrôle satellite et de la télédétection. Safran Data System (SDS) emploie plus de 700 salariés répartis en France (Les Ulis, Colombelles et Arcachon), en Allemagne et aux États-Unis. La division Space & Communication (S&C) est spécialisée dans la maîtrise des télécommunications satellites et explorations spatiales au service de prestigieux partenaires comme l'ESA, la NASA, le CNES ou la JAXA en maîtrisant les liens Hyperfréquences (Antenne Satellite et Chaînes d'émissions/réception Hyper) ou encore des Modems Haut Débit pour l'imagerie spatiale et le contrôle satellite. Elle est également spécialisée dans les liaisons de données Flight Test.
Dans le cadre de ses activités de recherche centrées sur les nouvelles formes d'onde à haute efficacité spectrale pour liaison de données pour les essais en vol, SDS propose à un.e étudiant.e un stage de dernière année de master afin d'étudier l'implémentation d'un nouvel algorithme de synchronisation sur sa plateforme FPGA embarquée dans un récepteur haut débit . A ce titre, l'étudiant.e sera amené.e à parcourir l'état de l'art sur cette thématique, puis à comprendre une première implémentation Matlab de l'algorithme visé, pour finalement l'implémenter sur cible FPGA . Une implémentation C puis synthèse HLS pourra également être envisagé.
Description des missions :
- Comprendre le fonctionnement de la chaine de réception
- Comprendre la code Matlab à implémenter sur cible
- Analyse et raffinage de l'algorithme en fonction de contraintes fixes (Horloge FPGA, parallélisation amont, échantillonneur choisi, quantification, ?)
- Application sur cible (connaissances en FPGA et en VHDL nécessaires).
- Mesure des performances sur banc RF.
Profil recherché
Safran est un groupe international de haute technologie opérant dans les domaines de la propulsion et des équipements aéronautiques, de l'espace et de la défense. Implanté sur tous les continents, le Groupe emploie plus de 92 000 collaborateurs pour un ch
Descriptif mission
Safran Data Systems, entité du groupe Safran, conçoit et fabrique une large gamme de produits et solutions dans les domaines de la télémesure bord & sol, du traitement embarqué de l'information, de l'acquisition et enregistrement de données, du contrôle satellite et de la télédétection. Safran Data System (SDS) emploie plus de 700 salariés répartis en France (Les Ulis, Colombelles et Arcachon), en Allemagne et aux États-Unis. La division Space & Communication (S&C) est spécialisée dans la maîtrise des télécommunications satellites et explorations spatiales au service de prestigieux partenaires comme l'ESA, la NASA, le CNES ou la JAXA en maîtrisant les liens Hyperfréquences (Antenne Satellite et Chaînes d'émissions/réception Hyper) ou encore des Modems Haut Débit pour l'imagerie spatiale et le contrôle satellite. Elle est également spécialisée dans les liaisons de données Flight Test.
Dans le cadre de ses activités de recherche centrées sur les nouvelles formes d'onde à haute efficacité spectrale pour liaison de données pour les essais en vol, SDS propose à un.e étudiant.e un stage de dernière année de master afin d'étudier l'implémentation d'un nouvel algorithme de synchronisation sur sa plateforme FPGA embarquée dans un récepteur haut débit . A ce titre, l'étudiant.e sera amené.e à parcourir l'état de l'art sur cette thématique, puis à comprendre une première implémentation Matlab de l'algorithme visé, pour finalement l'implémenter sur cible FPGA . Une implémentation C puis synthèse HLS pourra également être envisagé.
Description des missions :
- Comprendre le fonctionnement de la chaine de réception
- Comprendre la code Matlab à implémenter sur cible
- Analyse et raffinage de l'algorithme en fonction de contraintes fixes (Horloge FPGA, parallélisation amont, échantillonneur choisi, quantification, ?)
- Application sur cible (connaissances en FPGA et en VHDL nécessaires).
- Mesure des performances sur banc RF.
- Date de début nc.
- Durée 6 mois
- Expérience requise Débutant / Jeune diplomé
- Salaire nc.
- Référence SDSSTF24STAG131047
- Secteur d'activité